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ADE7816
SPI Interface Timing
Table 3. SPI Interface Timing Parameters
Data Sheet
SS to SCLK Edge
Parameter
E
A A
SCLK Period
Symbol
t SS
Min
50
0.4
Max
4000 1
Unit
ns
μs
MISO Disable After SS Rising Edge
SS High After SCLK Edge
SCLK Low Pulse Width
SCLK High Pulse Width
Data Output Valid After SCLK Edge
Data Input Setup Time Before SCLK Edge
Data Input Hold Time After SCLK Edge
Data Output Fall Time
Data Output Rise Time
SCLK Rise Time
SCLK Fall Time
E
A A
E
A A
1
Guaranteed by design.
t SL
t SH
t DAV
t DSU
t DHD
t DF
t DR
t SR
t SF
t DIS
t SFS
175
175
100
5
0
100
20
20
20
20
200
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
SS
SCLK
t SS
t SL
t SFS
t DAV
t SH
t SF
t SR
t DIS
MISO
MSB
INTERMEDIATE BITS
t DF
t DR
LSB
INTERMEDIATE BITS
MOSI
t DSU
MSB IN
t DHD
Figure 3. SPI Interface Timing
Rev. A | Page 6 of 48
LSB IN
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